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DE10-Nano套件助力全球FPGA设计大赛



关于 FPGA 创新大赛

创造嵌入式计算的未来!

亚洲、北欧和北美 Terasic 创新大赛激励众多志存高远的工程师不断地设计、创造和创新。 今年,这些地区性比赛合并为一场全球性比赛——FPGA 创新大赛。届时,来自全世界的团队将同台竞技,他们将与 Terasic 和 Intel 一起创造嵌入式计算的未来。 所有人均可参赛,包括学生、教授、创客和企业。 团队可通过实际成果和实际设计展现创造力和创新能力。 入选团队将获得免费 DE10-Nano 开发套件

  • 各地区决赛获胜者将有幸全程免费(即免住宿、餐饮和路费)参加于美国加利福尼亚州圣何塞市举行的总决赛。
  • 地区决赛和总决赛获胜团队将获得总额超过 30,000 美元的现金奖励。
  • 注册日期截止 2017 年 12 月 31 日。
Terasic DE10-Nano

比赛平台

Terasic DE10-Nano 开发套件采用 Intel® Cyclone® FPGA,是一款适合创客、教学人员和物联网系统开发人员的可重新配置型硬件设计平台。 该套件包含一块具有两个通用输入/输出 (GPIO) 扩展针座和一个 Arduino* 针座的板件,因而可连接多种传感器。

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单击了解大赛详情

 
Terasic DE10-Nano

特性

FPGA 器件

  • Intel Cyclone® V SE 5CSEBA6U23I7 器件 (110 K LE)
  • 串行配置器件 - EPCS128
  • 用于编程的板载 USB-Blaster II;JTAG 模式
  • HDMI TX,兼容 DVI 1.0 和 HDCP v1.4
  • 两个按钮
  • 四个滑动开关
  • 八个绿色用户 LED
  • 三个由时钟发生器提供的 50 MHz 时钟源
  • 两个 40 引脚扩展针座
  • 一个 Arduino 扩展针座(兼容 Uno R3),可与 Arduino 扩展板连接
  • 1 个 10 引脚模拟输入扩展针座(与 Arduino 模拟输入共享)
  • A/D 转换器、4 引脚 SPI,带 FPGA

HPS(硬处理器系统)

  • 800 MHz 双核 ARM Cortex-A9 处理器
  • 1 GB DDR3 SDRAM(32 位数据总线)
  • 1 千兆位以太网 PHY RJ45 连接器
  • USB OTG 端口,USB micro-AB 连接器
  • 微型 SD 卡插槽
  • 加速计(I²C 接口 + 中断)
  • UART 转 USB、USB Mini-B 连接器
  • 暖复位按钮和冷复位按钮
  • 一个用户按钮和一个用户 LED
  • LTC 2x7 扩展针座

如何展示 FPGA 优点:

提升性能 

  • 执行一项任务或功能时,FPGA 的速度快于 CPU。
  • 使用 FPGA 卸载 CPU 中的任务或功能,让处理器有空闲来执行其他任务。
 

适应变化 

  • 使用 FPGA 执行将随着标准、计算方法或安全威胁变化而变化的任务或功能。
  • 使用 FPGA 展示设计随时间变化的可扩展性,能够不断扩展或提升系统功能。

扩展 I/O 

  • 使用 FPGA 增加一个或多个非原生的处理器接口。
  • 使用 FPGA 为应用量身打造定制外设集。
查看 Terasic 子卡 查看 TERASIC 母板


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